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Description
Richard Munden demonstrates how to create and use simulation models for verifying ASIC and FPGA designs and board-level designs that use off-the-shelf digital components. Based on the VHDL/VITAL standard, these models include timing constraints and propagation delays that are required for accurate verification of today's digital designs. ASIC and FPGA Verification: A Guide to Component Modeling expertly illustrates how ASICs and FPGAs can be verified in the larger context of a board or a system. It is a valuable resource for any designer who simulates multi-chip digital designs.
Spécifications
Parties prenantes
- Auteur(s) :
- Editeur:
Contenu
- Nombre de pages :
- 336
- Langue:
- Anglais
- Collection :
Caractéristiques
- EAN:
- 9780125105811
- Date de parution :
- 01-09-04
- Format:
- Livre broché
- Format numérique:
- Trade paperback (VS)
- Dimensions :
- 195 mm x 241 mm
- Poids :
- 816 g
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